为计数脉冲计数CP的波形图,分别画出输出端Q的波形图

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出门在外也不愁主从JK触发器的输出波形Q主从.1.t=t1时,J=K=0,触发器应保持原初始状态0..
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画出图P42由或非门组成的基本RS触发器输出端Q
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淘豆网网友近日为您收集整理了关于09电科《数电》考试试卷A 张的文档,希望对您的工作和学习有所帮助。以下是文档介绍:09电科《数电》考试试卷A 张 “数字电子技术”试卷(A 卷) 第 1 页共 4 页池州学院
学年第一学期“数字电子技术”课程考试试卷 A 卷命卷人张勋友审卷人时国平审核人题号一二三四五总分分数得分评卷人一、单项选择题:本大题共 5 小题,每小题 3 分,共 15 分。1、请判断以下哪个电路不是时序逻辑电路( )。A、计数器 B、寄存器 C、译码器 D、触发器2、已知逻辑函数与其相等的函数为( )。A、 B、 C、 D、3、一个 8 选一数据选择器的地址输入端有( )个。A、1 B、2 C、3 D、44、 L=AB+C 的对偶式为:( )A、 A+BC ; B、( A+B )C ; C、 A+B+C ; D、 ABC ;5、JK 触发器要实现 Qn+1=1 时,J、K 端的取值为( )。A、J=0,K=1 B、J=0,K=0 C、J=1,K=1 D、J=1,K=01、(30.25)D = ( )B = ( )H 。2、十进制数 45,用 8421 码可以写成;格雷码为。3、逻辑函数式 F=ABC+ A + B +C 的逻辑值为。4、触发器有种稳定状态;用 4 个触发(来源:淘豆网[/p-7350094.html])器可以存储位二进制数。5、TTL 与非门的多余输入端悬空时,相当于输入电平。6、一个 4 位移位寄存器串行输入 4 位数码,至少经过个时钟脉冲,可并行输出全部数据;至少在第个时钟脉冲后,才串行输出全部序列。7、逻辑门电路中,最基本的逻辑门是、和。8、与非门构成的基本 RS 触发器,当 DS =0、 DR =0 时,其 Q 端输出状态是。得分评卷人二、填空题:本大题共 20 个空,每空 1 分,共 20 分。___________系___________专业___________班级姓名:_____________学号:__________________…………………………………密………………………………………封…………………………线………………………“数字电子技术”试卷(A 卷) 第 2 页共 4 页9、已知函数:Y AB C
,约束条件:BC=0 的三变量卡诺图中有个最小项,有个无关项。10、RS 触发器的特性方程为,JK 触发器的特性方程为,T 触发器的特性方程为,D 触发器的特性方程(来源:淘豆网[/p-7350094.html])为。1、 Y1= A + (代数法)2、 Y2(A,B,C,D)=∑m (3,6,8,9,11,12)+∑d (0,1,2,13,14,15)(卡诺图法)1、写出如图所示电路的最简逻辑表达式。得分评卷人三、化简题:本大题共 2 小题,每小题 5 分,共 10 分。得分评卷人四、分析题:本大题共 3 小题,第 1 小题 5 分,第 2 小题 10 分,第 3小题 15 分,共 30 分。“数字电子技术”试卷(A 卷) 第 3 页共 4 页2、触发器电路和 CP 及输入波形如图所示,试根据 CP 及输入波形画出输出端 Q1 、Q2 的波形。设各触发器的初始状态均为“0”。3、试写出如图所示电路的驱动方程、状态方程、输出方程,并画出状态转换真值表和状态转换图,检查自启动,说明逻辑功能。CPAQ2ACPD QQ___________系___________专业___________班级姓名:_____________学号:__________________…………………………………密……………………(来源:淘豆网[/p-7350094.html])…………………封…………………………线………………………“数字电子技术”试卷(A 卷) 第 4 页共 4 页1、用 3-8 线译码器 74LS138 和与非门电路实现一位全加器。2、用一片 74LS161(具有异步清零和同步置数的功能)实现十进制计数器(分别用复位法和置数法实现)。得分评卷人五、设计题:本大题共 2 小题,第 1 小题 15 分,第 2 小题 10 分,共 25 分。播放器加载中,请稍候...
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09电科《数电》考试试卷A 张 “数字电子技术”试卷(A 卷) 第 1 页共 4 页池州学院
学年第一学期“数字电子技术”课程考试试卷 A 卷命卷人张勋友审卷人时国平审核人题号一二三四五总分分数得分评卷人一、单项选择题:本大题共 5 小题,每小题 3 分,共 15 分。1、请判断以下哪个电路不是时序逻辑电路( )。A、计数器 ...
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