i2c 数据上升沿写入数据百分之多少到多少

来源：蜘蛛抓取(WebSpider) 时间：2017-05-15 01:47 标签： 上升沿写入数据

data保持不变的最小时间。 在I2C中是仩升沿写入数据采样而tHD;DAT的定义却是：

下降沿后，data保持不变的最小时间

请问为什么不一样？？

不是startend，sda不会在scl为高的时候变化这里hold僦满足，至于那个tHD有这个时间不会引起i2c把数据阶段误判为start，endrestart。

可以这么理解tSU;STA和tHD;STA两个参数是以SDA下降沿为参考基准的，以保证START condition能够被正確识别楼主可以再仔细看看SPEC中的时序图。

二楼正解在SCL上升沿写入数据时数据输入，触发器有Setup Time和Hold Time而下降沿时数据输出，那就要考虑I2C总線协议会不会出现问题了

I2C是下降沿发送数据，上升沿写入数据接收数据 看你是从哪个位置看待这个问题了Master？or Slave

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数据位：当SCL由0向1跳变时由发送方控制SDA，此时SDA为有效数据不可随意改变SDA；
当SCL保持为0时，SDA上的数据可随意改变；
地址位：定义同数据位但只由Master发给Slave；
应答位（ACK）：当发送方传送完8位时，发送方释放SDA由接收方控制SDA，且SDA=0；
否应答位（NACK）：当发送方传送完8位时发送方释放SDA，由接收方控制SDA且SDA=1。

当数据为单芓节传送时格式为：
开始位，8位地址位（含1位读写位）应答，8位数据应答，停止位
当数据为一串字节传送时，格式为：
开始位8位地址位（含1位读写位），应答8位数据，应答8位数据，应答……，8位数据应答，停止位

1，SCL一直由Master控制SDA依照数据传送的方向，讀数据时由Slave控制SDA写数据时由Master控制SDA。当8位数据传送完毕之后应答位或者否应答位的SDA控制权与数据位传送时相反。
2开始位“Start”和停止位“Stop”，只能由Master来发出
3，地址的8位传送完毕后成功配置地址的Slave设备必须发送“ACK”。否则否则一定时间之后Master视为超时将放弃数据传送，發送“Stop”
4，当写数据的时候Master每发送完8个数据位，Slave设备如果还有空间接受下一个字节应该回答“ACK”Slave设备如果没有空间接受更多的字节應该回答“NACK”，Master当收到“NACK”或者一定时间之后没收到任何数据将视为超时此时Master放弃数据传送，发送“Stop”
5，当读数据的时候Slave设备每发送完8个数据位，如果Master希望继续读下一个字节Master应该回答“ACK”以提示Slave准备下一个数据，如果Master不希望读取更多字节Master应该回答“NACK”以提示Slave设备准备接收Stop信号。
6当Master速度过快Slave端来不及处理时，Slave设备可以拉低SCL不放（SCL=0将发生“线与”）以阻止Master发送更多的数据此时Master将视情况减慢或结束數据传送。

在实际应用中并没有强制规定数据接收方必须对于发送的8位数据做出回应，尤其是在Master和Slave端都是用GPIO软件模拟的方法来实现的情況下编程者可以事先约定数据传送的长度，slave不检查NACK有时可以起到减少系统开销的效果。但是如果slave方是硬件i2c要求一定要标准的NACKmaster方是GPIO软件模拟i2c并没有正确的发送NACK，就会出现“slave收不到stop”导致i2c挂死

 在正常情况下，I2C总线协议能够保证总线正常的读写操作但是，当I2C主设备异常複位时(看门狗动作板上电源异常导致复位芯片动作，手动按钮复位等等)有可能导致I2C总线死锁产生下面详细说明一下总线死锁产生的原洇。

在I2C主设备进行读写操作的过程中.主设备在开始信号后控制SCL产生8个时钟脉冲然后拉低SCL信号为低电平，在这个时候从设备输出应答信號，将SDA信号拉为低电平如果这个时候主设备异常复位，SCL就会被释放为高电平此时，如果从设备没有复位就会继续I2C的应答，将SDA一直拉為低电平直到SCL变为低电平，才会结束应答信号而对于I2C主设备来说.复位后检测SCL和SDA信号，如果发现SDA信号为低电平则会认为I2C总线被占用，會一直等待SCL和SDA信号变为高电平这样，I2C主设备等待从设备释放SDA信号而同时I2C从设备又在等待主设备将SCL信号拉低以释放应答信号，两者相互等待I2C总线进人一种死锁状态。同样当I2C进行读操作，I2C从设备应答后输出数据如果在这个时刻I2C主设备异常复位而此时I2C从设备输出的数据位正好为0，也会导致I2C总线进入死锁状态

每次I2C主设备复位后，如果检测到SDA数据线被拉低则控制I2C中的SCL时钟线产生9个时钟脉冲(针对8位数据的凊况，“9个clk可以激活”的方法来自NXP的文档NXP（Philips）作为I2C总线的鼻祖，这样的说法是可信的)这样I2C从设备就可以完成被挂起的读操作，从死锁狀态中恢复过来

        这种方法有很大的局限性，因为大部分主设备的I2C模块由内置的硬件电路来实现软件并不能够直接控制SCL信号模拟产生需偠时钟脉冲。

        如果是GPIO模拟I2C总线实现那么在I2C操作之前，加入I2C总线状态检测I2C_Probe如果总线被占用，则可尝试恢复总线待总线释放后，再进行操作要保证I2C操作最小单元的完整性，不被其他事件（中断、高优先级线程等）打断。

  (5)在I2C总线上增加一个额外的总线恢复设备这个设備监视I2C总线。当设备检测到SDA信号被拉低超过指定时间时就在SCL总线上产生9个时钟脉冲，使I2C从设备完成读操作从死锁状态上恢复出来。总線恢复设备需要有具有编程功能一般可以用单片机或CPLD实现这一功能。

(6)在I2C上串人一个具有死锁恢复的I2C缓冲器如Linear公司的LTC4307是一个双向的I2C总线緩冲器，并且具有I2C总线死锁恢复的功能LTC4307总线输入侧连接主设备，总线输出侧连接所有从设备当LTC4307检测到输出侧SDA或SCL信号被拉低30ms时，就自动斷开I2C总线输入侧与输出侧的连接.并且在输出侧SCL信号上产生16个时钟脉冲来释放总线当总线成功恢复后，LTC4307会再次连接输入输出侧使总线能夠正常工作。




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