写一篇论文：基于Verilog HDL的逻辑电路数字电路数字钟论文设计

来源：蜘蛛抓取(WebSpider) 时间：2017-06-10 15:23 标签： 逻辑电路数字电路数字钟论文

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课程设计（报告）任务书

Ⅰ、课程设计（报告）题目：

Ⅱ、课程设计（论文）工作内容

实验课教学是它的一个极为重要

不论理论学习还是实际应用

如果不在切实认真地抓好学生

的实践技能的锻炼上下功夫，

势必出现理论与实践脱节、

项目设计》的目的就是让同学们在理论学习的基础上通过完成一个涉

忣时序逻辑、组合逻辑、声光输出的，具有实用性、趣味性的小系统设计使学生不但能够

将课堂上学到的理论知识与实际应用结合起来，

解决实际的数字电路问题

进一步加深认识为今后能够独立进行某些数字应用系统的开发设计工作打下一定的基础。

二、课程设计任务與要求

）设计一个数码管实时显示时、分、秒的数字时钟（

）为了演示方便应具有分钟、小时快进功能；

）时、分、秒设置功能（选作）

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